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本人向中国知识产权局专利局就变压器技术与计算机技术申报了三项专利,其中变压器技术的专利申请号分别为2003106666612与2006100675341,计算机技术的专利申请号为2008100860163。申请号为2003106666612的专利在实审过程中向申请人发了两次实审意见通知书，本人就实审意见通知书做了意见陈述，专利局用没有在实审意见通知书中提出的问题作废了本专利。申请号为2006100675341的专利公开日为2007年9月5日，申请人在2009年2月28日通过圆通快递向专利局寄发了实质审查请求书，圆通快递在北京的投递过程中出了问题，2009年3月6日才投送到专利局，专利局认定为投递是3月10，作废了本专利。2008年10月17日，专利局从北京发出了对申请号为2008100860163的补正通知书，2008年12月21日申请人通过圆通快递向专利局寄发出补正书文件，该补正文件在2008年12月23日投送到专利局，专利局以超出了补正期限作废了本专利。有句话叫欲加之罪，何患无辞？本人近几年来住在新乡，联系人地址是河南省淇县，专利局发出的普通邮件从北京到淇县一般情况8到10天，从淇县把邮件捎到新乡一般5到7天，也就是说，本人收到邮件的实际时间一般为15天，按15天计算，补正书送到专利局的最后期望是2009年1月1日，按最短期限8天是2008年12
月25日，何来超出期限？

依据上述情况，本人做以下猜测：（1）铁了心要作废本人的全部专利，到了不讲道理的程度。（2）申请号为2008100860163的专利在撰写专利文件时累的头昏，一不小心在3月3日多次使用U盘时被梁上君子偷了一把，可能梁上君子想让我成为安东尼奥.梅乌奇第二。（3）为了增加中国邮政的财源，限制其他公司参与每年上亿元的有关专利的邮资，凡是使用中国邮政以外的邮寄一概作废专利。（4）专利局的审查员审查专利的数量与收入挂了钩。本人申请的三项专利均需要花费大量的时间才能达到做出审查意见的程度，其审查过程的工作量相当于一般专利审查工作量的几十倍到几百倍，当审查专利的数量与效益挂钩时，对审查工作量大的专利胡乱找个理由给废了，免得影响收入。

上述专利在科技上、在应用上均有巨大价值。变压器的两项专利本人还在做挽回损失的评估，不再多说，仅就计算机技术这项专利做一简要说明。
计算机是利用电压信号的有与无来定义数学上的1与0，用1与0进行二进制运算。计算机的基础运算是加减乘除算术运算，复杂的函数运算也是展开成级数做算术运算。早期的计算机进行算术运算是用加减乘除算术电路进行，但是二进制码规则做的算术电路电路级数长，使用元件多，运算速度慢，并且四种算术电路其电路长度相差太大带来了运算时间相差太大，如64位的乘法电路处理一个数据的时间是加法电路处理一个位数相同的数据时间的几千倍到几万倍，64位除法电路处理一个数据的时间是减法电路处理同一个位数相同的数据时间的几万倍到几十万倍，CPU的应用效率差。再后来，计算机去掉了乘、除两种电路，用程序来模拟二进制规则的乘除运算，乘法运算由很多次加法运算完成，除法运算由很多次减法运算完成，减少了元件数量，摆脱逻辑门开关时间对运算速度的影响，通过提高主频来提高数据处理速度。但是，芯片的线刻度并不能无限度的减小，因而主频也不能无限度提高，计算机在二进制码下的运算速度也有极限，所以，克服二进制码的局限性从理论上讲是量子计算机。

为了搞物质多参数与物质时空变换、变压器、计算机编码三项研究，我全家花费了近十七年时间。十七年来，负债累累，连累亲戚朋友，苦了妻子儿子，至今一贫如洗。在三项研究即将全部完成之际，又遭意外损失，痛心疾首。本该是金秋收获，得到的却是冷霜冰雪，奈何？
在我受损之后，接下来受损的将是国家。数字绳码技术成为公开技术后，中国的微处理器产业由机遇转换成了灾难，将再无挤身世界前列的机会。变压器技术的专利成了公开技术后，中国更多的产业将受到比前者更大的伤害。我不想为这个问题多说，司马迁在《报任安书》中曾无奈地感叹“谁为为之？孰令听之？”。时间会说明一切。

本人的发明是用数字绳码来编码解码并设计算术电路，以原始人的结绳计数方法做原理模型。发明的思路是先把二进制码编译成数字绳码，再用数字绳码进行运算，结果用一个浮标结表达，最后把浮标结解码成二进制码。用数字绳码可以分别设计加减乘除四种算术电路，加法是移动结，减法是比较结，乘法除法是用数字千变尺来量，原理非常漂亮，，但是，用数字尺设计的乘、除电路所需的元件数量太多，几乎是天文数字，没有实用价值，所以，乘法电路仍然用加法原理，除法电路实质是倒数电路，倒数电路是乘法电路在特定情况下的逆电路。尽管也是用加法原理来进行乘除运算，但数字绳码乘除电路的相加逻辑与二进制码的相加逻辑完全不同，64位或128位乘法电路从二进制数据进入电路到二进制结果出电路有20级就能完成，除法有40级电路就能完成。在专利申报文件中，乘法原理只做了少量简单说明，除法原理（包括一些逻辑完美的原理图）全部删除。减法电路在原理上也合理，也具有实用性，但用加法做减法运算更省元件并且级数更少，所以，减法运算也是加法运算。这样，数字绳码的运算逻辑就是通过移动实结相加，并行分级相加，并行跳级消结，浮标表达，解码还原，算术电路所用元件少，电路级数少，运算速度快。从逻辑上讲
，数字绳码规则电路与二进制码规则电路做64位算术运算比较，加减运算速度提高上千倍，乘除运算提高几万到几十万倍，做128位算术运算比较，加减运算速度提高上万倍，乘除运算提高几百万到几千万倍。这样的运算速度，从理论上讲量子计算机也难以超越。

在应用上，由于CPU的运算指令是沿一条线作业，同时挂接加减乘除四个算术运算器有点浪费资源，数字绳码能够使减法运算共用加法电路，除法运算共用乘法电路，元件上又节省了不少。由于所用元件少，单片机可以外挂上数字绳码的算术电路或者直接使用数字绳码的算术电路，它将使单片机具有强大的数据处理功能，本人之所以认识到计算机技术上存在的问题，是因为在本人所申报的变压器专利的具体应用上发现单片机的数据处理能力太差，满足不了实时处理数据的要求。具备强大数据处理功能的单片机在工业控制、信息技术上有广泛的应用需求。由于所用元件少并且电路级数少，电子计算机将再次回到用硬件算术电路进行数据处理，在现有的同等条件下浮点数的处理速度将提高几万倍到几百万倍，尤其是英特尔公司称明年将推出32核的芯片，并向128核以上进军，在多核的同等条件下处理函数的速度将比现有的处理速度提高上亿倍，它对科学计算，对信息技术，都将产生巨大的影响。